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Exploración de técnicas de alto nivel en hardware para el desarrollo de redes neuronales

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Título: Exploración de técnicas de alto nivel en hardware para el desarrollo de redes neuronales
Autor: Valderrama Flórez, Manuel Alejandro; Agudelo Medina, Oscar Andrés
Fecha: 2016-02-25
URI: http://hdl.handle.net/11522/4163
Resumen: Given the recent advances in hardware synthesizers using high-level languages, in this work the design and implementation of an artificial neural network is proposed using hardware optimization techniques to take advantage of the properties of the network in terms of parallelism and available resources of the FPGA. For this, we will define the structure of a network that allows us to test and compare different hardware optimization techniques.
Descripción: Teniendo en cuenta los recientes avances en los sintetizadores de hardware usando lenguajes de alto nivel, en este trabajo de grado se propone el diseño e implementación de una red neuronal artificial utilizando técnicas de optimización de HLS que permitan aprovechar las propiedades de la red en términos de paralelismo y los recursos disponibles de la FPGA. Para esto se definirá la estructura de una red que nos permita realizar pruebas y comparar las diferentes técnicas de optimización de hardware.
Palabras clave: Redes neurales (Computadores)
 
Dispositivos FPGAs
Tipo: Trabajo de Grado
Citación: Valderrama Flórez, M. A., & Agudelo Medina, O. A. (2016, febrero 25). Exploración de técnicas de alto nivel en hardware para el desarrollo de redes neuronales. Pontificia Universidad Javeriana, Cali. Tomado de (http://hdl.handle.net/11522/4163).


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