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dc.contributorTamura Morimitsu, Eugenio
dc.creatorValderrama Flórez, Manuel Alejandro
dc.creatorAgudelo Medina, Oscar Andrés
dc.date2016-02-25
dc.date.accessioned2016-04-12T14:56:20Z
dc.date.available2016-04-12T14:56:20Z
dc.identifier.citationValderrama Flórez, M. A., & Agudelo Medina, O. A. (2016, febrero 25). Exploración de técnicas de alto nivel en hardware para el desarrollo de redes neuronales. Pontificia Universidad Javeriana, Cali.spa
dc.identifier.urihttp://hdl.handle.net/11522/4163
dc.descriptionTeniendo en cuenta los recientes avances en los sintetizadores de hardware usando lenguajes de alto nivel, en este trabajo de grado se propone el diseño e implementación de una red neuronal artificial utilizando técnicas de optimización de HLS que permitan aprovechar las propiedades de la red en términos de paralelismo y los recursos disponibles de la FPGA. Para esto se definirá la estructura de una red que nos permita realizar pruebas y comparar las diferentes técnicas de optimización de hardware.spa
dc.description.abstractGiven the recent advances in hardware synthesizers using high-level languages, in this work the design and implementation of an artificial neural network is proposed using hardware optimization techniques to take advantage of the properties of the network in terms of parallelism and available resources of the FPGA. For this, we will define the structure of a network that allows us to test and compare different hardware optimization techniques.spa
dc.formatapplication/pdfspa
dc.format.extent87 páginasspa
dc.languagespaspa
dc.publisherPontificia Universidad Javerianaspa
dc.relationhttp://webview.javerianacali.edu.co/cgi-olib/?oid=574904spa
dc.relation.urihttp://hdl.handle.net/11522/4168
dc.rightsEl o los autores otorgan licencia de uso parcial de la obra a favor de la Pontificia Universidad Javeriana Seccional Cali, teniendo en cuenta que en cualquier caso, la finalidad perseguida siempre será facilitar, difundir y promover el aprendizaje, la enseñanza y la investigación. Con la licencia el o los autores autorizan a la Pontificia Universidad Javeriana Seccional Cali: la publicación en formato o soporte material, de acuerdo con las condiciones internas que la Universidad ha establecido para estos efectos. La edición o cualquier otra forma de reproducción, incluyendo la posibilidad de trasladarla al sistema o entorno digital. La inclusión en cualquier otro formato o soporte como multimedia, colecciones, recopilaciones o, en general, servir de base para cualquier otra obra derivada. La comunicación y difusión al público por cualquier procedimiento o medio (impreso o electrónico). La inclusión en bases de datos y en sitios web, sean éstos onerosos o gratuitos, existiendo con ellos previo convenio perfeccionado con la Pontificia Universidad Javeriana Cali para efectos de satisfacer los fines previstos. En estos eventos, tales sitios tendrán las mismas facultades que las aquí concedidas para la referida universidad, con las mismas limitaciones y condiciones. El o los autores continúan conservando los correspondientes derechos sin modificación o restricción alguna, puesto que de acuerdo con la legislación colombiana aplicable, el acuerdo jurídico con la Pontificia Universidad Javeriana Cali, en ningún caso conlleva la enajenación del derecho de autor y de sus conexos. EL AUTOR, expresa que el artículo, folleto o libro objeto de la presente autorización es original y la elaboró sin quebrantar ni suplantar los derechos de autor de terceros, y de tal forma, el recurso electrónico aquí presentado es de su exclusiva autoría y tiene la titularidad sobre éste. PARÁGRAFO: en caso de queja o acción por parte de un tercero referente a los derechos de autor sobre el recurso electrónico en cuestión, EL AUTOR, asumirá la responsabilidad total, y saldrá en defensa de los derechos aquí autorizados; para todos los efectos, la Pontificia Universidad Javeriana Cali actúa como un tercero de buena fe.spa
dc.rights.urihttp://creativecommons.org/licenses/by-nc-nd/2.5/co/*
dc.subjectFacultad de Ingenieríaspa
dc.subjectPrograma de Ingeniería Electrónicaspa
dc.subjectRedes neurales (Computadores)spa
dc.subjectDispositivos FPGAsspa
dc.titleExploración de técnicas de alto nivel en hardware para el desarrollo de redes neuronalesspa
dc.typeinfo:eu-repo/semantics/bachelorThesisspa
dc.audiencePontificia Universidad Javeriana communityspa
dc.audienceResearchsspa
dc.audienceJournalistsspa
dc.audienceOtherspa
dc.contributor.roleConsultor de tesisspa
dc.coverageCali; Lat: 03 24 00 N degrees minutes; Lat: 3.4000 decimal degrees; Long: 076 30 00 W degrees minutes; Long: -76.5000 decimal degreesspa
dc.creator.degreeIngeniero Electrónicospa
dc.publisher.facultyIngenieríaspa
dc.publisher.programIngeniería Electrónicaspa
dc.pubplace.cityCalispa
dc.rights.accesoAcceso abiertospa
dc.rights.accessRightsinfo:eu-repo/semantics/openAccessspa
dc.rights.ccAtribución-NoComercial-SinDerivadas 2.5 Colombia*
dc.source.bibliographicCitationVivado Design Suite User Guide HLS, 9 2015.spa
dc.source.bibliographicCitationZynq-7000 all programmable soc. http://www.xilinx.com/products/ silicon-devices/soc/zynq-7000.html, . (Visited on 01/08/2016).spa
dc.source.bibliographicCitationVivado Design Suite AXI Reference Guide, 6 2015.spa
dc.source.bibliographicCitationZynq-7000 All Programmable SoC Technical Reference Manual, 2 2015.spa
dc.source.bibliographicCitationAmos R Omondi and Jagath Chandana Rajapakse. FPGA implementations of neural networks, volume 365. Springer, 2006.spa
dc.source.bibliographicCitationJihan Zhu and Peter Sutton. Fpga implementations of neural networks–a survey of a decade of progress. In Field Programmable Logic and Application, pages 1062–1066. Springer, 2003.spa
dc.source.bibliographicCitationGrant Martin and Gary Smith. High-level synthesis: Past, present, and future. IEEE Design & Test of Computers, (4):18–25, 2009.spa
dc.source.bibliographicCitationAndrew Canis, Jongsok Choi, Mark Aldham, Victor Zhang, Ahmed Kammoona, Jason H Anderson, Stephen Brown, and Tomasz Czajkowski. Legup: high-level synthesis for fpga-based processor/accelerator systems. In Proceedings of the 19th ACM/SIGDA international symposium on Field programmable gate arrays, pages 33–36. ACM, 2011.spa
dc.source.bibliographicCitationPhilippe Coussy, Daniel D Gajski, Michael Meredith, and Andres Takach. An introduction to high-level synthesis. IEEE Design & Test of Computers, (4):8–17, 2009.spa
dc.source.bibliographicCitationJason Cong, Bin Liu, Stephen Neuendorffer, Juanjo Noguera, Kees Vissers, and Zhiru Zhang. High-level synthesis for fpgas: From prototyping to deployment. Computer-Aided Design of Integrated Circuits and Systems, IEEE Transactions on, 30(4):473–491, 2011.spa
dc.source.bibliographicCitationWim Vanderbauwhede and Khaled Benkrid. High-Performance Computing Using FPGAs. Springer, 2013.spa
dc.source.bibliographicCitationZynq ultrascale+ mpsoc. http://www.xilinx.com/products/silicon-devices/ soc/zynq-ultrascale-mpsoc.html, . (Visited on 11/30/2015).spa
dc.source.bibliographicCitationVivado design suite. http://www.xilinx.com/products/design-tools/vivado. html, . (Visited on 11/30/2015).spa
dc.source.bibliographicCitationFilippo Amato, Alberto Lopez, Eladia María Peña-Méndez, Petr Vanhara, Ales Hampl, and Josef Havel. Artificial neural networks in medical diagnosis. Journal of applied biomedicine, 11(2):47–58, 2013.spa
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dc.source.bibliographicCitationZedboard — zedboard. http://zedboard.org/product/zedboard. (Visited on 11/30/2015).spa
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dc.source.bibliographicCitationUbuntu. http://www.ubuntu.com/download. (Visited on 11/30/2015).spa
dc.source.bibliographicCitationPetalinux tools. http://www.xilinx.com/products/design-tools/ embedded-software/petalinux-sdk.html. (Visited on 01/19/2016).spa
dc.source.bibliographicCitationDownload putty - a free ssh and telnet client for windows. http://www.putty.org/. (Visited on 01/21/2016).spa
dc.source.bibliographicCitationEthan E Danahy, Sos S Agaian, and Karen A Panetta. Algorithms for the resizing of binary and grayscale images using a logical transform. In Electronic Imaging 2007, pages 64970Z–64970Z. International Society for Optics and Photonics, 2007.spa
dc.source.bibliographicCitationHenry Rowley, Shumeet Baluja, Takeo Kanade, et al. Neural network-based face detection. Pattern Analysis and Machine Intelligence, IEEE Transactions on, 20 (1):23–38, 1998.spa
dc.source.bibliographicCitation] Simon Haykin and Neural Network. A comprehensive foundation. Neural Networks, 2(2004), 2004.spa
dc.source.bibliographicCitationAvinash Kaushal and JPS Raina. Face detection using neural network & gabor wavelet transform. IJCST, 1(1), 2010.spa
dc.source.repositoryVitela: Repositorio Institucional PUJspa
dc.source.institutioninstname:Pontificia Universidad Javeriana Cali.spa
dc.subject.lembRedes neurales (Computadores)spa
dc.subject.lembDispositivos FPGAsspa
dc.type.hasversioninfo:eu-repo/semantics/publishedVersionspa
dc.type.spaTrabajo de Gradospa


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